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我很难理解OpenCL特别是OpenCL 2.0+是共享的，分布式的还是分布式的共享内存架构，尤其是与具有许多OpenCL的计算机设备在同一台PC上。特别是，我可以看到它是一个共享内存系统，它们都可以访问全局内存，但是他们的计算单元具有类似网络的特点，这让我怀疑它是否可以经典地归类为分布式共享内存架构

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当代处理器与纯冯诺依曼体系结构有何不同？

所以我从来没有真正理解冯诺依曼架构，并开始修改它，因为我在CPU课程中没有上过学。由于他们不回复他们的电子邮件，因此无法通过我的老师获得帮助。我已经了解了冯诺依曼架构，现在我需要知道架构与当代处理器的不同之处。我知道，当代处理器有时使用哈佛和冯诺依曼架构的混合通过使用哈佛在控制单元和缓存之间的通信，但出于成本效益的原因，主存储器和CPU之间使用冯诺依曼。虽然说明点希望知道它有何不同，但我会非

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分页和分段之间的差异

我想了解内存管理的两种范例;但是，我没有看到大图和两者之间的差异。寻呼包括从辅助存储器到主存储器的固定大小页面，以便完成某个进程请求的任务。分割包括为进程中的每个单元分配一个地址空间，因此它们可以增长。我不清楚他们是如何相关的，这是因为我的理解仍然存在很多漏洞。有人可以填补他们吗？

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有人可以解释这个关于操作系统中的分页吗？

通常，在32位CPU上，每个页表项都是4个字节长，但是该大小也可以变化。一个32位条目可以指向一个 2^32物理页面帧。如果帧大小为4 KB（2^12），则带有4字节条目的系统可以寻址2^44字节（或16 TB）的物理内存。我们在这里应该注意，分页内存系统中的物理内存大小与进程的最大逻辑大小不同。分页如何使逻辑内存空间超过物理内存空间？ 32位CPU中的帧总数是否等于2 ^（32-12）=

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指令缓存是否存储操作码？

我正试图计算指令缓存命中率。我在模拟器中模拟了一个缓存并用PC提供。我想知道是否需要报告命中率，因为在缓存中找到的PC数量或找到的PC数量以及它们的OpCode字段是否匹配？这些问题可以追溯到指令缓存目的的本质。指令缓存是否被用来检索OpCodes？正如我们在分支目标缓冲区（BTB）中存储分支目标一样。在BTB的情况下，我们计算一旦有PC命中并且目标匹配时的命中率。（更详细地说：一旦分支预测器

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MIPS - 静态多重发送中的转发

在MIPS的静态双重发行管道上，我可以使用两条指令在同一时钟周期内运行的转发路径吗？例如： 1. add $t0, $t0, $t1 2. sw $t0, 0($t2) 我可以执行在同一时钟周期这两个指令？ sw可能会在执行MEM阶段时使用add的结果值。这是正确的吗？

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如何将armv7二进制文件转换为i386/x86_64

我正在尝试构建一个mac（可可）应用程序。我有一个框架，我试图链接到已编译为iOS（armv7拱门）。不幸的是我不再拥有我用来编译原始框架的源代码。是否有可能改变框架的架构（可能通过反编译然后重新编译），以便它可以编译到我的可可应用程序中？到目前为止，我已经研究过lipo和fat二进制文件以及使用optool进行反编译，但是没有对转换架构做任何直接的改进。感谢您的帮助。

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有没有办法检查应用程序的操作系统是32位还是64位？

确定它是否为64位的布尔值是完美的，但表示位数量的整数也可以。我想捕获一些关于PC架构的信息以便进行统计。

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努力摆脱存储位置的最大范围

有人可以帮助我理解这个问题：处理器提供的寻址主64GB内存，如AMD FX8350 下列哪项是主存储器位置的正确maximun范围对于这样的处理器？ A.0x000为0x3FF B.0x0 0000到0x3F FFFF C.0x000 0000为0x3FF FFFF D.0x0 0000 0000到0x3F FFFF FFFF E. 0x0 000 000 000 TO 0x3F FFFF FF

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一次调用多少数据将从内存传输到CPU

由于CPU的内存速度要慢得多，所以它应该以一些'x'Bytes的块为单位发送数据。这个'x'的大小是多少？数据线b/n内存和CPU是否也是x * 8位通道？如果我访问内存上的地址'A'，它是否会将所有下一个x-1内存地址发送到缓存？内存总线的工作频率是多少？ SIMD - SSE和MMX扩展是否利用这种批量阅读功能？请随时提供任何参考。在此先感谢。