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    数质蕴涵和EPI

    我的TA的解决这个问题，总理蕴涵（PI）为 f(a,b,c,d)= Sigma m(0,2,4,5,8,10,11,13,15) 号是7和必要的PI（EPI）的数量是1。这将如何计算？我认为这是错误的。任何想法？ 我的解决办法是：
    computer-architecture digital-logic vlsi digital-design 2015-02-23

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    数字设计简单操作发现复用和解码？

    我的文件不是数字设计，但我遇到了一个简单的问题。如何在不使用真值表的情况下找到以下两个图的操作？ （这些即写式）
    computer-architecture decoder digital-design 2015-04-14

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    编译错误：在这种情况下，网络不是合法的左值

    我是Verilog的新手，在定义if-else循环时遇到问题。该错误消息是 A net is not a legal lvalue in this context" for all assign statements in the given code. always @(adbar) if (adbar==1'b1) begin assign Z[0] = m_out[0]
    verilog asic digital-design 2015-04-23

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    可编程逻辑器件

    我对理解PAL器件的结构有困惑。 我的第一个问题是，如果我们购买了PAL设备，那么我们怎么能知道OR数组中每个OR门添加了多少个分项？换句话说，我问，有没有什么标准可以让我们知道每个OR门在OR数组中有多少个输入？ 接下来就是我们在可编程的PAL设备中有一个AND阵列。现在假设我们有4个输入，那么AND阵列中的每个AND门都需要8个输入。这取决于我们应用了多少变量，但是我们可以将所有变量应用于与门
    signal-processing digital-logic digital-design 2010-01-08

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    如何思考数字电路设计

    如何思考如何以抽象的方式设计数字逻辑芯片？ 我目前正在研究“计算系统的元素”我在第一章中，我从Nand开始实现了以下大门。 不 而且 或者 异或 复用器 DMUX 16位不 16位和 16位或者 16位复用 8路或者 现在我卡试图实现16位四路复用。 我试过把真值表转换成规范的表示法，但是我最终得到了一个巨大的混乱。使用规范表示对“较小”芯片运行良好，但现在非常复杂。我怎么能考虑把一个“复杂”的芯
    hardware logic circuit digital-design 2011-10-17

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    仅使用解复用器设计一个或门

    仅通过使用解复用器来显示或门操作。 我知道这是非常不切实际的实施，但这些类型的问题正在被要求在分班考试中。 http://i.stack.imgur.com/mQAZD.png 退房OR门真理如果从上述链接
    digital-design 2014-02-13

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    “警告C0007：架构有未绑定的实例”问题！

    我从附有“数字设计基础”一书的CD中获得以下源代码。 当我试图运行程序时，它给了我下面的错误： Compiling Fig17_13.vhd... C:\Users\SPIDER\Desktop\EE460\The Final Project\Fig17_13.vhd(25): Warning C0007 : Architecture has unbound instances (ex. ct2
    counter vhdl digital-design 2011-05-27

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    16位阵列需要5位地址（Xilinx Vivado HLS）？

    我是赛灵思HLS的新手。我正在接受教程ug871-vivado-high-level-synthesis-tutorial.pdf（第77页）。 的代码是 #define N 32 void array_io (dout_t d_o[N], din_t d_i[N]) { //..do something } 合成后，我得到了像 我很困惑报告如何地址端口的宽度已经自动调整大
    hardware xilinx synthesis digital-design 2015-02-11
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