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    什么是RISC-V，它与以前的RISC体系结构相比如何？

    什么是RISC-V？为什么创建？它比以前的RISC架构有什么改进？ （这意味着是在计算器上RISC-V维基。）
    riscv 2014-09-30

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    调试简单的C与斯派克（riscv-ISA-SIM）

    我正在秒杀简单的C和汇编程序汇编程序（这工作正常）。我有麻烦运行峰值调试模式。尽管我正在尝试调试不同的程序，但我始终得到相同的输出。我现在用的是riscv64未知精灵-gcc生成的C语言和汇编代码的可执行二进制文件和下面的命令也说明：http://riscv.org/download.html#tab_isa-sim运行调试模式： $ spike -d pk simpleprogram 我也得
    riscv spike 2015-03-03

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    火箭核心实现RISCV的RV64G版本？

    我想知道，哪个版本的riscv ISA是能够实现的发布的火箭核心。 既然它支持双精度浮点，我可以安全地假设它是RV64G版本。
    riscv 2014-10-17

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    查询有关FSIM的Verilog与火箭核心的Zedboard Verilog代码

    有人能帮助解释差异是由火箭核心的FSIM目录中生成的Verilog代码之间是什么（Top.DefaultFPGAConfig.v，使用默认的conf文件提供）和Zedboard文件夹中的verilog代码（Top.DefaultFPGAConfig.v）？他们或多或少是相同的大小，看起来相似，除了一些变化，我不明白背后的原因.. 我想在virtex 7 FPGA而不是基于Zynq的板上综合它，但只
    riscv 2014-10-20

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    riscv火箭核心上的内存映射I/O

    如何在火箭上进行未缓存的内存访问？有没有办法指定哪些区域的内存映射应该启用或禁用缓存？ 在任何文档中我找不到任何关于此内容的内容，但是如果我忽略了某些内容，我会很乐意收到指向此文档的链接。 Asbjørn
    riscv 2014-10-20

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    如何编译RV32I的dhrystone基准测试

    当我尝试编译riscv-sodor中的dhrystone基准测试版时，发现无法识别的操作码“amoadd”错误退出编译。 riscv-gcc -m32 -Wa,-march=RV32I -std=gnu99 -O2 -nostdlib -nostartfiles -DPREALLOCATE=1 -DHOST_DEBUG=0 \ -c -I../env -I./common -I./
    gcc riscv 2014-12-09

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    riscv-tools安装需求？

    我对RISCV软件工具感兴趣，并且在linux和toolchain有一些 知识。我想在我的系统 上运行ubuntu 14.04 - 32位安装riscv工具。我尝试了github中给出的步骤，并且构建失败。您可以在http://pastebin.com/QN3B1q45 中看到错误日志。这个版本是否有任何基本要求？ 请指导我解决这个问题。
    toolchain riscv 2014-10-27

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    使用特定指令集设置RISC-V工具链

    我正在开发使用RISC-V ISA形式的处理器，我目前正在尝试设置工具链。 我目前的处理器设计使用RV32I基本指令集，我想编译这个ISA。但是，编写在http://RISCV.org站点上的工具链的默认配置是为RV64I ISA编译的。 我该如何重新配置​​这个工具链来生成RV32I ISA的二进制文件？
    toolchain riscv risc 2015-02-06

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    如果将QNaN和SNaN用作浮点移动指令（FMV.XS）的输入，可能的输出和异常可能是什么

    如果将QNaN和SNaN应用为浮点移动指令（ FMV.XS），RISC-V 32位实现的可能输出和例外可能是什么
    riscv 2014-10-31

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    未对齐的指令访问 - spike pk hello

    我在测试RISC-V工具链时收到'Misaligned instruction access'异常。 hello.c的内容与README文件中提供的示例相匹配。 有没有人遇到过这个问题？ $ riscv-gcc -o hello hello.c $ spike pk hello z 0000000000000000 ra 0000000000000000 sp 000000000000000
    riscv 2014-12-31
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